UVM hdl 访问函数的 hdl 路径中的正则表达式

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我想知道我可以使用正则表达式(正则表达式)作为 UVM 中任何 HDL 访问函数(如 uvm_hdl_deposit() 或 uvm_hdl_check_path())的字符串吗?

如果不是,是不是因为 DPI 中没有这样的功能?

如果没有直接的方法在 HDL 访问中使用 reg exp,我将不胜感激任何解决办法。

提前感谢大家。

system-verilog uvm system-verilog-dpi
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uvm_hdl_deposit 例程不提供对正则表达式的支持。 VPI/DPI 没有内置机制来执行此操作。您必须构建一个范围内所有名称的数据库,然后扫描数据库以查找匹配的名称。

许多工具都有命令行界面,支持某种形式的正则表达式来执行存款等命令,这样您就可以避免编写 C 接口代码。

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