DE1-SOC上的最大时钟频率

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在DE1-SOC板中Altera PLL可以产生的最大时钟频率是多少?

verilog fpga intel-fpga
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我无法在任何Cyclone V文档中找到最大PLL频率的参考。然而,(根据我自己的实验),Altera PLL宏功能/ IP核不会产生频率高于1.6 GHz(1600 MHz)的生成时钟。

也就是说,我怀疑你能够快速为任何CV电路(甚至完全流水线)提供时钟。

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