有关Quartus的问题,这是Altera / Intel开发的一款软件工具,用于协助HDL设计的设计,分析和综合,包括FPGA和CPLD。
错误 (10200):top_module.v(12) 处的 Verilog HDL 条件语句错误:无法匹配操作数
我有三个版本的代码,我不想要逻辑明智,但为什么语法明智。 模块顶部模块( 输入时钟, input areset, // 异步高电平有效复位为零 输入负载, 输入ena, ...
我尝试对数组执行或归约操作。当赋值左边是寄存器数组时就可以了。当赋值的左侧是一个导线数组时,则只有...
我尝试对数组执行或归约操作。当赋值左边是寄存器数组时就可以了。当赋值的左侧是一个导线数组时,则只有...
综合和推断 ROM 存储器设计中的 quartus prime 问题 - Verilog
当我尝试按照 quartus prime 模板建议为我的项目编写定制 ROM 时,我最终得到了这个模块: // Quartus Prime Verilog 模板 // 单端口 ROM 模块内存 #(
我正在 Intel Quartus Prime Lite 23.1 中使用 Arduino MKR Vidor 4000 的模板项目。具体来说,它使用 Cyclone 10 LP 10CL016YU256C8G。 现在我正在尝试编写一个模块...
代码块下方没有消息窗口 我正在使用 Quartus eda 工具通过 verilog HDL 进行 fpga 作业。 为了编译,我需要消息窗口来了解代码块中的错误。 但我找不到
综合不会减少 quartus prime lite 23.1 中我的系统verilog 设计文件中 rtl 查看器中的门
我在systemverilog设计文件中编译了愚蠢的函数f(a,b,c) = sum minterms(0,4,5) 网表 RTL 查看器向我展示了一个奇怪的门示意图 ~a&~b&~c + (a&~b)&c + (a&~b)&...
为 FPGA DE1-soc 分配 HPS 使用的 SD 卡引脚
我正在遵循教程并对其进行一些更改。这个项目使用 Nios2,目标是使用 DE1-soc 板的 SD 卡插槽并从 sd 卡读取 bmp 图像文件并发送我...
Intel Questas_fse/Quartus II 中的仿真波形不更新输出
我正在尝试运行 Quartus II ( Quartus Prime 版本 21.1.0 Build 842 10/21/2021 Sj Lite Edition)在 Linux Pop OS 21.10 上。 我无法从
我是使用 System Verilog 进行硬件设计的新手,所以我正在尝试编译一个非常非常简单的文件:D Flip Flop。 它由以下代码组成(取自https://www.chipverify.com/verilog/
Verilog HDL 快速排序错误:在终止条件中必须仅使用常量表达式
我正在尝试在 Quartus II 中运行此 Verilog 代码,但由于 for 它不起作用。 模块 verilog_qs( 输入线时钟, 输入线 [10:0] in1, in2, in3, in4, in5, in6, in7, in8, in9, in...
这是一个2端口数据存储器的代码,当我在quartus上编译它时 内存位数为零,并将其全部实现为逻辑元素,并且不会影响 RAM 怎么解决呢? 模块
我刚刚开始使用Verilog。我的第一个项目是一个用 16 位输入控制 4 个 7 段显示器的模块。我的 BCDtoSSeg 模块如下: 模块 BCDtoSSeg(BCD、SSe...
模块路径1(输出,输入,w0,w1,w2,w3,w4,w5,w6,w7,w8,w9); 输入; 输出输出; 输出w0、w1、w2、w3、w4、w5、w6、w7、w8、w9; 不是(w0,在); 不是(w1,w0); 不是(w2,w1); 不是(w3,w2); 不是(w4,w3)...
我正在尝试在英特尔的 Quartus Prime 上编写一个简单的 Verilog 模块和测试平台,并在 Questa FPGA 模拟器上检查它的波形。 该代码基本上有一个时钟和一个 4 位计数器。 ...
为什么使用 Quartus、Vivado 和 Libero 运行 Synthesis 每次都花费相同的时间?
对于我迄今为止使用过的所有 FPGA 工具:Intel Quartus Prime、Xilinx Vivado、Microsemi Libero SoC,每当我运行综合时,它总是花费相同的时间。我所期望的是
我正在尝试使用 QuestaSim(直接从 Quartus 运行)来运行测试平台,相关部分概述如下。 `时间尺度 1 ns / 10 ps 模块 ASS1_T3_tb(); 参数 NumBits = 8; int fd;...
QuestaSim 新手:它似乎跳过了我的初始块的主体,有什么想法吗?
我正在尝试使用 QuestaSim(直接从 Quartus 运行)来运行测试平台,相关部分概述如下。 `时间尺度 1 ns / 10 ps 模块 ASS1_T3_tb(); 参数 NumBits = 8; int fd;...
我正在使用 Quartus 开发 Altera 的 DE12-115 微处理器。为了使用内置 VGA 连接将 BMP 图像显示到显示器上,我必须首先将 BMP 图像转换为 i...