riscv 相关问题

RISC-V是一种新的指令集架构（ISA），最初设计用于支持计算机体系结构研究和教育，现在已成为RISC-V Foundation治理下的行业实现的标准开放架构。

RISC-V 中的函数寄存器问题

目前使用CREATOR RISC-V模拟器：Creator 4.0 RISC-V (RV32IMFD) 教学和通用汇编编程模拟器我正在尝试执行 sin 函数，并且我接触了一点......

function assembly cpu-registers riscv

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RISC-V GCC 编译器错误编译 ASM 代码

我正在编写一个嵌入式C程序来测试我在FPGA板上开发的硬件IP。我在使用 RISC-V GCC ASM 语法时发现了这个奇怪的问题。这是我写的代码...

c assembly gcc inline-assembly riscv

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RISC-V 实现无分支的离散函数

考虑在集合 {-3, -2, -1, 0, 1, 2, 3} 中的整数上定义的离散值函数 f。定义： f(-3) = 6 f(-2) = 61 f(-1) = 17 f(0) = -38 f(1) = 19 f(2) = 42 f(3) = 5 我正在努力

arrays function indexing riscv branchless

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clang 警告参数在编译 -fsanitize-address-outline-instrumentation 期间未使用

我正在尝试测试标志 -fsanitize-address-outline-instrumentation 是否适用于 LLVM Clang 编译器。 Ubuntu 铿锵版本 15.0.7 我创建了一个示例程序：主程序 #包括...

clang llvm riscv

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如何将管道中产生的微架构值与其相应的架构指令相匹配？

我的目标是匹配由执行标量、有序 RISCV pro 的相应指令产生的所有管道值（处理器中微架构状态的所有信号）...

simulation cpu-architecture riscv processor

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为什么 sstatus 和 mstatus 虽然是同一个寄存器的不同视图，但它们的寄存器地址不同？

sstatus 寄存器是 mstatus 寄存器的子集。在简单的实现中，读取或写入 sstatus 中的任何字段相当于读取或写入 ms... 中的同名字段...

cpu-architecture privileges riscv instruction-set

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如何连接 B 型 RISC-V 指令的立即数？

我需要解码来自 RISC-V 指令的以下二进制文件：11111110000011100001100011100011 使用RISC-V参考卡，我了解以下信息：它的操作码是11000...

assembly riscv instruction-encoding immediate-operand

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Xiao ESP32-C3（基于 RISC-V）浮点汇编指令上无法识别的操作码

我正在尝试在 Seeed Xiao ESP32-C3 上实现 Ivan Kostoski 的基于 ESP32 的声级计的代码。根据 Seeed 的 wiki，该芯片“是一个 32 位 RISC-V CPU，其中包括一个 FPU (

assembly esp32 arduino-ide riscv

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为什么你会对机器模式感到不安？

在 RISC-V 中，何时能够从机器模式陷阱处理程序中进行 sret 有用？我不太明白。据我所知，与使用 mret 的唯一区别是它会检查 SPP

riscv

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汇编 RISC v 中的指针

我正在研究 RISC V 汇编中的指针，但是看到教授的代码让我想知道他是否犯了错误，或者我是否遗漏了某些内容。该练习是关于从 C 转换为汇编 R...

c pointers assembly riscv

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为什么 RISC-V CRC 算法在 verify_image 上失败？

我有一个在 FPGA 上实现的 CVA6 设计，我已经连接了 OpenOCD，并将图像写入 RAM 后，我尝试验证它。但验证失败，我收到此消息验证图像 uImage

linux image riscv openocd risc

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在扩展汇编中调用宏

我想在c代码的扩展汇编中添加一个宏。这可能吗？我尝试过这样的事情： asm 易失性（“li t0，0xcafebabe;”“li t1，0x00c0fee;”INSERT_...

c assembly riscv riscv32

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在尝试读取寄存器值之前添加NOP

添加 nop 是否是一个好主意，以便在再次从寄存器地址读取之前添加一些延迟以获得预期值并退出 while 循环？或者继续阅读寄存器是否可以...

c assembly embedded riscv

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RISC V LD 错误 - (.text+0xc4)：重定位被截断以适合：R_RISCV_JAL 针对 `*UND*'

有谁知道我为什么会遇到以下错误：- /tmp/cceP5axg.o：在函数“.L0”中： (.text+0xc4)：重定位被截断以适合：R_RISCV_JAL 针对“*UND*” 收集2：错误：ld

riscv

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如果ELF可执行文件中没有.data部分，GP寄存器设置为多少？

我正在制作一个 RISC-V 64 位模拟器，并为其添加 ELF 文件支持。我在某处读到，您应该分配一个堆栈并在 SP 寄存器中设置一个指向它的指针，同时设置...

assembly emulation elf cpu-registers riscv

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为什么RISC-V ISA中有很多零目标指令不影响硬件？

第一个寄存器是RISC-V ISA中的硬件零。它用于许多情况，例如将零调用到另一个寄存器，以及跳转但不存储地址等。然而，有很多可能性......

cpu-architecture riscv instruction-set

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如何在jetbrains CLion中连接gdb调试链以实现RISCV峰值？

RISCV行为模型SPIKE，支持通过rbb端口调试。这样我们就可以通过gdb来调试了。下图中，我将SPIKE rbb_port设置为：18700，openocd连接到spike并服务于：3973，...

gdb clion riscv openocd

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如何为 Risc-V（汇编语言）编写 NOT 运算？

如何为 Risc-V（汇编语言）编写 NOT 运算？如果没有 NOT 指令，你如何实现同样的目标？

assembly bitwise-operators riscv bitwise-not

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RISCV李指令

在RISCV汇编中，“li”是伪指令。我有这个指令：李t2，0x1800 csrc mstatus，t2 “li”被组装成以下2条指令。吕X7 2 广告...

assembly riscv

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如何将一段机器代码打包为.o目标文件中的函数

目标：给定一段机器代码，其中包含 RISC-V 扩展指令，我想将其包装为函数并创建一个 .o 目标文件。该函数类似于 void foo()，没有

object compilation elf riscv low-level-code

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